三級網(wǎng)絡(luò)課堂：基于SoC的IPSec協(xié)議實現(xiàn)技術(shù)

　　(2)lP庫的選擇 

　　IP庫的選擇應(yīng)針對器件類型，選擇通用的IP核。對安全性要求較高的算法模塊，應(yīng)采取訪問控制、抗解剖分析等技術(shù)措施；對可變邏輯模塊，應(yīng)采用FPGA，以保證可編程的特點。

　　(3)芯片結(jié)構(gòu)的選擇 

　　SoC的主體部分由CPU和ASIC組成。在設(shè)計過程中，芯片結(jié)構(gòu)的選擇應(yīng)從系統(tǒng)應(yīng)用規(guī)劃、協(xié)議處理速度要求、便于實現(xiàn)、Vetilog HDL編程實現(xiàn)結(jié)構(gòu)化，以及所用邏輯模塊的實際結(jié)構(gòu)等幾個角度入手。 

　　Altera的SoC芯片[5]構(gòu)成如圖2所示。 

　　(4)軟硬件系統(tǒng)設(shè)計 

　　SoC的基本結(jié)構(gòu)是具有一個成多個微處理器，以及可編程硬件邏輯，因此，在SoC設(shè)計中必須進(jìn)行軟硬件的協(xié)同設(shè)計。軟硬件協(xié)同設(shè)計的技術(shù)性很強，它既有SoC設(shè)計的靈活性，又有SoC設(shè)計中難以揣摩、充滿變數(shù)的復(fù)雜性，將涉及到硬件資源的規(guī)劃和整個系統(tǒng)性能的實現(xiàn)。

　　(5)系統(tǒng)集成設(shè)計 

　　系統(tǒng)集成設(shè)計的關(guān)鍵技術(shù)，主要是IP核的無縫連接系統(tǒng)設(shè)計和相關(guān)的可測試技術(shù)，包括緊密耦合、傳輸特性、時鐘綜合和測試接口等。

　　(6)低功耗管理設(shè)計 

　　低功耗設(shè)計是對有相關(guān)要求的器件進(jìn)行的一種設(shè)計技術(shù)，設(shè)計中主要通過一些系統(tǒng)狀態(tài)、橋接控制等來實現(xiàn)。

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